低偏斜、低抖动PLL时钟驱动器;1至5差分时钟分布(SSTL_18)
特色
- 用于输入输出同步的反馈引脚
- 扩频容忍输入
- 当输入信号处于特定逻辑状态时自动PD
起订量: 1
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低偏斜、低抖动PLL时钟驱动器;1至5差分时钟分布(SSTL_18)
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